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Figure 1-1.
Block Diagram
REG_DEC
V S _VREG
IREF
V S _ S YNA
VREG_VCO
VCO
REG
BIA S
V S _ S YND
V S _IFA
V S _IFD
V S _TRX
RX_IN
LNA
IR-MIXER
BP
LIMITER
DIGITAL
DEMOD
RX_DATA
R SS I
RON_OUT
RX_ON
OUTPUT
CLOCK
B u ffer
BU S
DATA
ENABLE
TX_OUT
PA
VCO
PLL
CTRL
LOGIC
RX_ON
TX_ON
HB S
2
ATR2820
TX_MOD
CP/VT
I_COMP
REF_CLK
4704BS–DECT–12/08
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